processeur_ARO2.circ

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<project integrity="e8eb3c3e82dd47ddbf0fb38a5ece3c1b4295a784" source="2.16.8.t" version="1.0">
  This file is intended to be loaded by Logisim-evolution (https://github.com/reds-heig/logisim-evolution).

  <lib desc="#Wiring" name="0">
    <tool name="Splitter">
      <a name="facing" val="west"/>
      <a name="owner" val="autogen:prodis"/>
      <a name="date" val="29.04.14 11:40:05"/>
      <a name="version" val="2.10.6.1"/>
      <a name="uuid" val="cc30de22-b2a2-49a8-8148-621514e7d753"/>
      <a name="integrity" val="94c97077dc645a9a5961a033f263102e68f0e1d1"/>
    </tool>
    <tool name="Pin">
      <a name="width" val="6"/>
      <a name="label" val="Code"/>
      <a name="owner" val="autogen:prodis"/>
      <a name="date" val="29.04.14 11:40:05"/>
      <a name="version" val="2.10.6.1"/>
      <a name="uuid" val="d12596bb-e49d-4d46-b0dc-5c7d100fe93d"/>
      <a name="integrity" val="9c200588cd11827d4332797449fe4332273e6726"/>
    </tool>
    <tool name="Probe">
      <a name="facing" val="south"/>
    </tool>
    <tool name="Tunnel">
      <a name="width" val="16"/>
      <a name="label" val="Val_Rn"/>
    </tool>
    <tool name="Clock">
      <a name="highDuration" val="4"/>
      <a name="lowDuration" val="4"/>
      <a name="owner" val="autogen:prodis"/>
      <a name="date" val="29.04.14 11:40:05"/>
      <a name="version" val="2.10.6.1"/>
      <a name="uuid" val="a650981a-5b19-4416-a77b-3c4ecefa37d4"/>
      <a name="integrity" val="377bce6710623459fa705558d8837121f2e66a77"/>
    </tool>
    <tool name="Constant">
      <a name="value" val="0x0"/>
    </tool>
  </lib>
  <lib desc="#Gates" name="1"/>
  <lib desc="#Plexers" name="2">
    <tool name="Multiplexer">
      <a name="enable" val="false"/>
    </tool>
    <tool name="Demultiplexer">
      <a name="enable" val="false"/>
    </tool>
  </lib>
  <lib desc="#Arithmetic" name="3"/>
  <lib desc="#Memory" name="4">
    <tool name="ROM">
      <a name="contents">addr/data: 8 8
0
</a>
    </tool>
  </lib>
  <lib desc="#I/O" name="5"/>
  <lib desc="#HDL-IP" name="6">
    <tool name="VHDL Entity">
      <a name="content">--------------------------------------------------------------------------------
-- HEIG-VD, institute REDS, 1400 Yverdon-les-Bains
-- Project :
-- File    :
-- Autor   :
-- Date    :
--
--------------------------------------------------------------------------------
-- Description :
--
--------------------------------------------------------------------------------

library ieee;
  use ieee.std_logic_1164.all;
  --use ieee.numeric_std.all;

entity VHDL_Component is
  port(
  ------------------------------------------------------------------------------
  --Insert input ports below
    horloge_i  : in  std_logic;                    -- input bit example
    val_i      : in  std_logic_vector(3 downto 0); -- input vector example
  ------------------------------------------------------------------------------
  --Insert output ports below
    max_o      : out std_logic;                    -- output bit example
    cpt_o      : out std_logic_Vector(3 downto 0)  -- output vector example
    );
end VHDL_Component;

--------------------------------------------------------------------------------
--Complete your VHDL description below
architecture type_architecture of VHDL_Component is


begin


end type_architecture;
</a>
    </tool>
  </lib>
  <lib desc="#TCL" name="7">
    <tool name="TclGeneric">
      <a name="content">library ieee;
use ieee.std_logic_1164.all;

entity TCL_Generic is
  port(
    --Insert input ports below
    horloge_i  : in  std_logic;                    -- input bit example
    val_i      : in  std_logic_vector(3 downto 0); -- input vector example

	  --Insert output ports below
    max_o      : out std_logic;                    -- output bit example
    cpt_o      : out std_logic_Vector(3 downto 0)  -- output vector example
  );
end TCL_Generic;
</a>
    </tool>
  </lib>
  <lib desc="#Base" name="8">
    <tool name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
  </lib>
  <main name="main"/>
  <options>
    <a name="gateUndefined" val="ignore"/>
    <a name="simlimit" val="1000"/>
    <a name="simrand" val="0"/>
    <a name="tickmain" val="period"/>
  </options>
  <mappings>
    <tool lib="8" map="Button2" name="Menu Tool"/>
    <tool lib="8" map="Button3" name="Menu Tool"/>
    <tool lib="8" map="Ctrl Button1" name="Menu Tool"/>
  </mappings>
  <toolbar>
    <tool lib="8" name="Poke Tool"/>
    <tool lib="8" name="Edit Tool"/>
    <tool lib="8" name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
    <sep/>
    <tool lib="0" name="Pin">
      <a name="owner" val="autogen:mim"/>
      <a name="date" val="16.01.20 10:47:58"/>
      <a name="version" val="2.11.3"/>
      <a name="uuid" val="785edbd5-3946-4787-b814-6ef2fa282fe5"/>
      <a name="integrity" val="1f3c7a5a396fdc2da1ab7ea84990d9e4d6bc0c59"/>
    </tool>
    <tool lib="0" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="labelloc" val="east"/>
      <a name="owner" val="autogen:mim"/>
      <a name="date" val="16.01.20 10:47:58"/>
      <a name="version" val="2.11.3"/>
      <a name="uuid" val="f3c4499c-8038-4722-83b3-4809a1b9b55c"/>
      <a name="integrity" val="4bd35dd60a767d2049260143e71f441141e42e25"/>
    </tool>
    <tool lib="1" name="NOT Gate">
      <a name="owner" val="autogen:mim"/>
      <a name="date" val="16.01.20 10:47:58"/>
      <a name="version" val="2.11.3"/>
      <a name="uuid" val="c686cc86-1df8-45e7-bac5-2d66d91455f4"/>
      <a name="integrity" val="dd452a928db9ad2a14f2ec419ac589db0d067f81"/>
    </tool>
    <tool lib="1" name="AND Gate">
      <a name="owner" val="autogen:mim"/>
      <a name="date" val="16.01.20 10:47:58"/>
      <a name="version" val="2.11.3"/>
      <a name="uuid" val="21327418-8aeb-40f7-9ce0-8a19c0dbd0cb"/>
      <a name="integrity" val="177ca8619adef10a7b77293d0dd08832a036265d"/>
    </tool>
    <tool lib="1" name="OR Gate">
      <a name="owner" val="autogen:mim"/>
      <a name="date" val="16.01.20 10:47:58"/>
      <a name="version" val="2.11.3"/>
      <a name="uuid" val="1fcc250b-b4fa-46ed-9ec6-ffe00e6336ed"/>
      <a name="integrity" val="2ffca272ca2e7700fb7a4c975dc3126b9f2fdfd3"/>
    </tool>
  </toolbar>
  <circuit name="main">
    <a name="circuit" val="main"/>
    <a name="clabel" val=""/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif bold 12"/>
    <a name="circuitnamedbox" val="true"/>
    <a name="circuitvhdlpath" val=""/>
    <wire from="(910,730)" to="(1090,730)"/>
    <wire from="(910,750)" to="(1090,750)"/>
    <wire from="(910,770)" to="(1090,770)"/>
    <wire from="(910,790)" to="(1090,790)"/>
    <wire from="(910,810)" to="(1090,810)"/>
    <wire from="(910,830)" to="(1090,830)"/>
    <wire from="(970,680)" to="(1030,680)"/>
    <wire from="(400,590)" to="(1030,590)"/>
    <wire from="(970,650)" to="(970,680)"/>
    <wire from="(810,190)" to="(810,220)"/>
    <wire from="(1030,590)" to="(1030,680)"/>
    <wire from="(400,140)" to="(400,170)"/>
    <wire from="(570,660)" to="(810,660)"/>
    <wire from="(930,690)" to="(930,710)"/>
    <wire from="(490,730)" to="(590,730)"/>
    <wire from="(490,770)" to="(590,770)"/>
    <wire from="(170,750)" to="(590,750)"/>
    <wire from="(170,910)" to="(200,910)"/>
    <wire from="(170,880)" to="(200,880)"/>
    <wire from="(950,680)" to="(970,680)"/>
    <wire from="(910,710)" to="(930,710)"/>
    <wire from="(400,170)" to="(400,590)"/>
    <wire from="(570,710)" to="(590,710)"/>
    <wire from="(1250,120)" to="(1260,120)"/>
    <wire from="(1250,410)" to="(1260,410)"/>
    <wire from="(720,220)" to="(810,220)"/>
    <wire from="(1230,130)" to="(1260,130)"/>
    <wire from="(1230,70)" to="(1260,70)"/>
    <wire from="(1230,110)" to="(1260,110)"/>
    <wire from="(1230,150)" to="(1260,150)"/>
    <wire from="(1230,420)" to="(1260,420)"/>
    <wire from="(1230,360)" to="(1260,360)"/>
    <wire from="(1230,400)" to="(1260,400)"/>
    <wire from="(1230,440)" to="(1260,440)"/>
    <wire from="(810,220)" to="(810,660)"/>
    <wire from="(400,170)" to="(480,170)"/>
    <wire from="(1370,770)" to="(1390,770)"/>
    <wire from="(1370,790)" to="(1390,790)"/>
    <wire from="(1370,810)" to="(1390,810)"/>
    <wire from="(1370,750)" to="(1390,750)"/>
    <wire from="(1370,830)" to="(1390,830)"/>
    <wire from="(1500,150)" to="(1520,150)"/>
    <wire from="(570,660)" to="(570,710)"/>
    <wire from="(1500,440)" to="(1520,440)"/>
    <wire from="(1070,870)" to="(1090,870)"/>
    <wire from="(1070,850)" to="(1090,850)"/>
    <comp loc="(910,710)" name="processeur_ARO2"/>
    <comp lib="0" loc="(170,910)" name="Clock">
      <a name="label" val="sysclk"/>
      <a name="owner" val="mim"/>
      <a name="date" val="16.01.20 11:25:11"/>
      <a name="version" val="2.14.7.t"/>
      <a name="uuid" val="1a08476d-5f53-4050-931a-e661f9681409"/>
      <a name="integrity" val="5675a284d5768bcfc0f6f7343c00ac887a242d0f"/>
    </comp>
    <comp lib="0" loc="(170,880)" name="Clock">
      <a name="highDuration" val="4"/>
      <a name="lowDuration" val="4"/>
      <a name="label" val="clk"/>
      <a name="owner" val="mim"/>
      <a name="date" val="16.01.20 11:25:11"/>
      <a name="version" val="2.14.7.t"/>
      <a name="uuid" val="c39a3597-5b17-4611-998e-9beab09a249d"/>
      <a name="integrity" val="cf0e977d522fabf4aca3a938350a408f94f2485c"/>
    </comp>
    <comp lib="0" loc="(200,880)" name="Tunnel">
      <a name="label" val="clk"/>
    </comp>
    <comp lib="0" loc="(200,910)" name="Tunnel">
      <a name="label" val="sysclk"/>
    </comp>
    <comp lib="0" loc="(930,690)" name="Splitter">
      <a name="fanout" val="1"/>
      <a name="incoming" val="16"/>
      <a name="owner" val="autogen:prodis"/>
      <a name="date" val="11.04.14 13:10:49"/>
      <a name="version" val="2.10.6.1"/>
      <a name="uuid" val="f50583d7-838e-484e-8f6c-87c3bed01fa3"/>
      <a name="integrity" val="6190606a41cf5e9ce722f6149279708c32e78fd0"/>
      <a name="bit0" val="none"/>
      <a name="bit1" val="0"/>
      <a name="bit2" val="0"/>
      <a name="bit3" val="0"/>
      <a name="bit4" val="0"/>
      <a name="bit5" val="0"/>
      <a name="bit6" val="0"/>
      <a name="bit7" val="0"/>
      <a name="bit8" val="0"/>
      <a name="bit9" val="0"/>
      <a name="bit10" val="0"/>
      <a name="bit11" val="0"/>
      <a name="bit12" val="0"/>
      <a name="bit13" val="0"/>
      <a name="bit14" val="0"/>
      <a name="bit15" val="0"/>
    </comp>
    <comp lib="0" loc="(970,650)" name="Probe">
      <a name="facing" val="south"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="0" loc="(810,190)" name="Probe">
      <a name="facing" val="south"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="0" loc="(400,140)" name="Probe">
      <a name="facing" val="south"/>
      <a name="radix" val="16"/>
    </comp>
    <comp lib="4" loc="(480,160)" name="ROM">
      <a name="addrWidth" val="15"/>
      <a name="dataWidth" val="16"/>
      <a name="contents">addr/data: 15 16
200f 211a 2305 3011 18c2 3201 1a8b 1e8c
391d 2104 8103 4301 8902 708a 7888 5444
5c42 5243 5a44 4010 80 8c0 4310 4244
405c 2002 41c2 43da 4102 109a 2000 2100
1842 d000 200c e00b 2100 11*0 202a 213c
46c0 46c0
</a>
      <a name="label" val="InstrMemory"/>
    </comp>
    <comp lib="4" loc="(1260,350)" name="RAM">
      <a name="addrWidth" val="15"/>
      <a name="databus" val="bibus"/>
      <a name="label" val="DataMemoryLow"/>
    </comp>
    <comp lib="4" loc="(1260,60)" name="RAM">
      <a name="addrWidth" val="15"/>
      <a name="databus" val="bibus"/>
      <a name="label" val="DataMemoryHigh"/>
      <a name="labelvisible" val="true"/>
    </comp>
    <comp lib="0" loc="(1520,440)" name="Tunnel">
      <a name="width" val="8"/>
      <a name="label" val="rd_data_low_s"/>
    </comp>
    <comp lib="0" loc="(1520,150)" name="Tunnel">
      <a name="width" val="8"/>
      <a name="label" val="rd_data_high_s"/>
    </comp>
    <comp lib="0" loc="(1230,130)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="sysclk"/>
    </comp>
    <comp lib="0" loc="(1230,420)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="sysclk"/>
    </comp>
    <comp lib="0" loc="(1250,410)" name="Constant"/>
    <comp lib="0" loc="(1250,120)" name="Constant"/>
    <comp lib="0" loc="(1230,70)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="width" val="15"/>
      <a name="label" val="memory_addr_s"/>
    </comp>
    <comp lib="0" loc="(1230,360)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="width" val="15"/>
      <a name="label" val="memory_addr_s"/>
    </comp>
    <comp lib="0" loc="(1230,400)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="low_write_en_s"/>
    </comp>
    <comp lib="0" loc="(1230,110)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="label" val="high_write_en_s"/>
    </comp>
    <comp lib="0" loc="(1230,150)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="width" val="8"/>
      <a name="label" val="wr_data_high_s"/>
    </comp>
    <comp lib="0" loc="(1230,440)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="width" val="8"/>
      <a name="label" val="wr_data_low_s"/>
    </comp>
    <comp lib="0" loc="(490,730)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="width" val="16"/>
      <a name="label" val="rd_data_s"/>
    </comp>
    <comp lib="0" loc="(1070,870)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="width" val="8"/>
      <a name="label" val="rd_data_low_s"/>
    </comp>
    <comp lib="0" loc="(1390,770)" name="Tunnel">
      <a name="width" val="8"/>
      <a name="label" val="wr_data_high_s"/>
    </comp>
    <comp lib="0" loc="(1070,850)" name="Tunnel">
      <a name="facing" val="east"/>
      <a name="width" val="8"/>
      <a name="label" val="rd_data_high_s"/>
    </comp>
    <comp lib="0" loc="(1390,830)" name="Tunnel">
      <a name="label" val="low_write_en_s"/>
    </comp>
    <comp loc="(1370,750)" name="memory_controller"/>
    <comp lib="0" loc="(1390,810)" name="Tunnel">
      <a name="label" val="high_write_en_s"/>
    </comp>
    <comp lib="0" loc="(1390,790)" name="Tunnel">
      <a name="width" val="8"/>
      <a name="label" val="wr_data_low_s"/>
    </comp>
    <comp lib="0" loc="(1390,750)" name="Tunnel">
      <a name="width" val="16"/>
      <a name="label" val="rd_data_s"/>
    </comp>
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      <a name="width" val="15"/>
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      <a name="text" val="enregistrez votre projet, toutes les"/>
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    </comp>
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    <comp lib="7" loc="(4,250)" name="Text" trackercomp="true">
      <a name="text" val="définitivement effacées."/>
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    </comp>
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      <a name="text" val="Attention, votre version de Logisim"/>
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      <a name="halign" val="left"/>
    </comp>
    <comp lib="7" loc="(4,100)" name="Text" trackercomp="true">
      <a name="text" val="ne contient pas de tracker. Si vous"/>
      <a name="font" val="SansSerif plain 48"/>
      <a name="halign" val="left"/>
    </comp>
    <comp lib="7" loc="(4,150)" name="Text" trackercomp="true">
      <a name="text" val="enregistrez votre projet, toutes les"/>
      <a name="font" val="SansSerif plain 48"/>
      <a name="halign" val="left"/>
    </comp>
    <comp lib="7" loc="(4,200)" name="Text" trackercomp="true">
      <a name="text" val="informations du tracker seront"/>
      <a name="font" val="SansSerif plain 48"/>
      <a name="halign" val="left"/>
    </comp>
    <comp lib="7" loc="(4,250)" name="Text" trackercomp="true">
      <a name="text" val="définitivement effacées."/>
      <a name="font" val="SansSerif plain 48"/>
      <a name="halign" val="left"/>
    </comp>
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    <comp lib="8" loc="(508,624)" name="Text">
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    <comp lib="8" loc="(947,554)" name="Text">
      <a name="text" val="L'état de PC va directement sur l'adresse d'instruction"/>
      <a name="font" val="SansSerif plain 12"/>
    </comp>
    <comp lib="0" loc="(550,650)" name="Splitter">
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    <comp lib="8" loc="(564,74)" name="Text">
      <a name="text" val="Permet le saut"/>
      <a name="font" val="SansSerif plain 12"/>
    </comp>
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      <a name="value" val="0x2"/>
    </comp>
    <comp lib="8" loc="(482,239)" name="Text">
      <a name="text" val="Increment du PC"/>
      <a name="font" val="SansSerif plain 12"/>
    </comp>
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    </comp>
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      <a name="text" val="enregistrez votre projet, toutes les"/>
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    <comp lib="7" loc="(4,200)" name="Text" trackercomp="true">
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    <comp lib="7" loc="(4,250)" name="Text" trackercomp="true">
      <a name="text" val="définitivement effacées."/>
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    </comp>
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      <a name="text" val="informations du tracker seront"/>
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    <comp lib="7" loc="(4,250)" name="Text" trackercomp="true">
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